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英特尔披露 Wildcat Lake 处理器：平台 AI 算力最高 40 TOPS，UCIe 多芯片封装_我的网站

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五 | 而 UCIe 是半导体行业内的一个开源、标准化的芯粒（Chiplet）互连规范，定义了同一个封装内部（On-Package）不同芯片之间的通信标准，旨在打破过去的壁垒，让来自不同厂商、采用不同晶圆工艺节点的芯片能够像拼乐高积木一样，无缝地组装和协同工作。英特尔 Wildcat Lake 的计算 Die 采用 18A 工艺，I/O Die 采用台积电 N6 工艺。

六 | 18A 支持双裸片方案的 UCIe 连接。这一变化也带来代价。UCIe 的凸点间距为 110 微米，Foveros 为 36 微米。

七 | 更大的间距要求更高的 GT/s 速率，并扩大 I/O 与控制器区域，让 Wildcat Lake 的 UCIe Die 间接口面积比 Foveros 方案大 70%。

八 | 与 Panther Lake 相比，Wildcat Lake 的计算 Die 面积缩小 38%。具体变化包括：Xe 图形核心最多 2 个，Panther Lake 为 4 个；保留用于 AI 的 XMX，取消光线追踪功能。NPU 减至最多 1 个，NPU 算力为 17 TOPS，平台总算力为 40 TOPS；Panther Lake 平台为 53 TOPS，NPU 为 3 个。P-Core 减至最多 2 个，Panther Lake 为 4 个；保留相同单线程性能，末级缓存从 12MB 减至 6MB。取消 IPU（图像处理单元）和用于摄像头的 USB 2 ISP。取消专业媒体功能。

九 | LP5 内存位宽从 128 位降至 64 位，系统缓存从 4MB 减至 2MB。显示管线最多 3 条，Panther Lake 为 4 条；保留 4K 60Hz 和 UHBR20 支持。

十 | 附上相关图片如下：。

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Published on:11:06:04